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Board Control Status Registers (BCSR)
Bit
[1]
[2]
[3]
Config Signals
G4ENA_XC
G3DIS_125
G4DIS_125
Function
? 1: Enable
? 0: Disable
? 1: Disable PHY3 clock_out 125MHz
? 0: Enable PHY3 clock_out 125MHz
? 1: Disable PHY4 clock_out 125Mhx
? 0: Enable
Default
[0]
[0]
[0]
Att
R,W
R,W
R,W
? 1: Disable SMII6 AND enable RMII6, TDM1C, UPC1
[4]
SMII6 DIS
Dev2, and UCC3
? 0: Enable SMII6 and TDM2D
[1]
R,W
(SMII unsupported)
? 1: Enable UCC8 RMII on PIB and TDM1H AND
[5]
SMII8 DIS
disable SMII8.
? 0: Enable SMII8
[1]
R,W
(SMII unsupported)
[6]
[7]
TDM1F
RUART1_nQEUART
? 1: Enable TDM1F
? 0: Disable TDM1F
? 1: Enable QE_UART
? 0: Enable UART1, TDM1D, and TDM2B
[1]
[0]
R,W
R,W
10.17 BCSR16
Table 24. BCSR16 Register
Bit
[0]
[1]
[2]
[3]
[4]
[5]
Config Signals
PORESET
TSEC0MST
TSEC1MST
TSEC2MST
TSEC3MST
TSEC4MST
Function
PWR_ON Reset/HRESET
? 0: Active
Reserved
Reserved
Reserved
Reserved
Reserved
Default
[1]
[1]
[1]
[1]
[1]
[1]
Att
R,W
R,W
R,W
R,W
R,W
R,W
? 1: Enable UPC1 Device2
? 0: Disable UPC1 Device 2 OR enable RMII3 on
PIB,TDM1C and TDM2C
[6]
TDM1C_DEV2
?
If bit = 0 then RMII3 is enabled
[0]
R,W
?
?
?
Dev2- RxEN_B[2]
TDM2c-TSYNC
TDM1c
[7]
RESERVED
-
[0]
R,W
MPC8569E-MDS-PB Hardware Getting Started, Rev. 3.1
Freescale Semiconductor
27
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